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RSS订阅原创 使用一片通用四运放芯片LM324组成电路（含报告+仿真）
使用低频信号源产生ui1=0.1sin2πft（V），f=500Hz的正弦波信号，加至加法器的输入端，加法器的另一输入端加入有自制振荡器产生的信号uo1。要求加法器的输出电压ui2=10 ui1+ uo1。ui2经选频滤波器滤除uo1频率分量，选出f信号为uo2，uo2为峰峰值等于9V的正弦信号，用示波器观察无明显失真。图表 1 基于LM324的 运放芯片的集成运算电路设计框图。word报告2000+字，包含公式，数据，图片…包含三角波产生电路，加法器，滤波器，比较电路。模电综合实验报告scu。
2025-05-21 10:49:39
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原创 [MATLAB]正四面体内的彩色小球运动
这个程序的核心是一个深黄色的小球在一个半透明的正四面体空间内自由运动。当小球撞击四面体的任意一个面时，会在撞击点留下一个浅黄色的标记，形成一个生动的运动轨迹可视化。
2025-03-30 22:40:32
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原创 【数据库信息系统】第3章关系代数与关系数据库理论
域是一组具有相同数据类型值的集合，例如：自然数、整数、实数、一个字符串、{男，女}关系代数是一种抽象的查询语言，是关系数据操作语言的一种传统表达方式，它是用关系的运算来表达查询的。
2024-12-21 21:48:42
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原创 第二章信息与数据模型习题
科室：科名、科地址、科电话、医生姓名 病房：病房号、床位号、所属科室名 医生：姓名、职称、所属科室名、年龄、工作证号病人：病历号、姓名、性别、诊断、主管医生、病房号 其中，一个科室有多个病房、多个医生，一个病房只能属于一个 科室，一个医生只属于一个科室，但可负责多个病人的诊治，一个病 人的主管医生只有一个。教师（职工号，姓名，年龄，家庭住址，电话） 如果一个学生可以选修多门课程，一门课程可以有多个学生选 修：一个教师只能讲授一门课程，但一门课程可以由多个教师讲授。1）指出学生与课程的联系类型。
2024-12-18 13:48:17
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原创 时域分析法，向量分析法，频域分析法（电路理论第五章，第六章，第七章）
感觉还是没写太全，有些输入为e的次方，以及输入为冲击函数或者阶跃函数时候，也可以用第七章的频域分析法（或者第五章后面卷积做），第五章后面卷积部分，感觉把5.17/5.20/5.21这样的题掌握了就行（算全响应）时域分析法，向量分析法，频域分析法（第五章，第六章，第七章）12月17日电路理论。
2024-12-18 00:34:10
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原创 （数据库系统原理）第2章 信息与数据模型
用户定义的完整性就是针对某一具体关系数据库 的约束条件，它反映某一具体应用所涉及的数据必须满足的语义要求。
2024-12-16 21:04:21
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原创 数据库系统概述知识点及习题
C：数据独立性实际上是指数据的物理结构和逻辑结构的独立性，即数据的存储方式（物理结构）变化时，不会影响用户视图（逻辑结构）。数据库中的数据是有组织地存储的，通常按照一定的数据模型（如关系模型）来组织数据，数据之间通过关系、约束等来维护其组织结构。A:数据库不仅仅保存数据，还包括数据之间的关系、约束、视图、索引等元数据，以及用于管理和维护数据的系统表和日志等。D:数据独立性指的是数据的物理存储细节和逻辑结构是分离的，物理变化不影响逻辑层，用户不需要关心数据是如何存储的。数字只是数据的一种类型。
2024-12-15 16:33:39
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原创 第1章 数据库系统概述
数据库系统（DataBase System，DBS）：一般由硬件系统、软件系统、数据库和人员组成。信息系统（lnformation System，IS）：是由计算机硬件、网络 和通信设备、计算机软件、信息资源、信息用户等组成的以处理信息 流为目的的人机一体化系统。
2024-12-15 15:09:59
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原创 12.2 块 ROM/RAM IP创建
简单双端口 RAM：相较单端口 RAM，多出一个 PORTB，有两个时钟，可以同时 读写，PORTA 只能写数据，PORTB 只能进行读数据。真双端口 RAM：两个 PORT，分别有自己的时钟，地址，输入/输出数据端口，两 个端口均可进行读写操作。RAM分为：单端口 RAM：读写一个时钟，读写不能同时进行。在RAM中可以不用设置Coe文件。我们这里选用简单双端口 RAM。点击OK后点击Generate。以块 RAM IP做例子。
2024-12-02 22:51:35
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原创 UART串口发送逻辑设计
*初学者学习FPGA的一些小心得和笔记，以免之后忘记。教程是跟着小梅哥AC620教学视频学的视频地址：【0基础学FPGA 2023全新版本——小梅哥AC620 FPGA开发板教学视频】 https://www.bilibili.com/video/BV1Ga4y1f7hy/?
2024-08-21 16:10:12
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原创 Quarter II破解出现Error (119013): Current license file does not support the EP4CE6F17C8 device，终于解决了！
在CSDN上跟着破解完了，在License Setup里面查询时间已经变成了2035.12，可是在编译的时候，明明代码都没有写错，可是还是会出现一个。本文主要探讨“EP4CE6F17C8 device”的这个error问题，软件安装过程可以看看其他博客，写的都挺清楚。由于野火的视频没有讲如何破解，于是自己去网上搜索了一下如何破解，但是因为没有注意，破解软件下载成了。，虽然可以在时间上成功破解，但是在编译时就会遇到错误。或者用的13.1版本，结果下载成13.0版本的破解器！，重新破解，成功编译！
2024-08-09 16:40:34
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原创 [verilog初学笔记]模块（module）调用
则在调用mod_a时候就应该按照顺序填写（By position）【一个萝卜一个坑】②按照名称对应，代码会更冗长，但不容易出错。若mod_a声明时顺序为【先声明了output】①按照声明mod_a时的顺序填写；现在已有一个声明了的mod_a模块，目的是将。则调用时要注意对应顺序，不要写错了。代码比较冗长，书写格式也像C语言。较为简洁，但容易对应错误。
2024-08-08 10:41:06
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原创 [verilog初学笔记]反转位顺序
verilog还是和C语言语法比较相近的，但也有不同。②用always @（敏感事件列表）描述时序逻辑。①直接用assign连续赋值语句描述组合逻辑。③用generate-for 循环生成语句。用for语句书写，而在verilog中。那如何用一个循环（loop）来写呢？我的理解是要给“for”语句穿个外套。
2024-08-08 10:21:23
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空空如也
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