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原创 有效圆形区域检测
因此,遍历各候选行,对于任一非零候选行,判断其左右两侧有效位置之差是否符合阈值sidesBias,若不符合,将该行左右列坐标置0,不再参与后续计算。若直径最大的候选行不唯一,则对于相同列坐标之和的候选行,使用累加求和的方式,获得行坐标pos和左侧列坐标left的均值。对于边缘像素均值超出阈值的情况,直接返回结果均为0的result,视为查找失败,将使用全部像素值进行统计计算。在图像中心位置附近选取间距相同的若干行,作为搜索边界候选行,对于各候选行,循环执行相似的操作,以确定各候选行中满足条件的左右列坐标。
2023-10-11 15:20:40
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原创 Xilinx累加器IP核使用记录
一开始没看IP使用手册,心想这么简单的累加器还不是手到擒来,没想到在使用中发现不少坑,记录一下使用Xilinx2020.2版本中的Accumulator(12.0)及DSP Macro(1.0)。设计目的是用Accumulator实现256个连续有效数据的累加。另外,使用DSP Macro是实现256个连续有效数据的累乘加。
2023-10-10 17:12:59
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原创 GTHE3开发记录3
IP Core内部有一个top顶层结构跟两个看不到结构(没看明白怎么生效)的GTHE4_powergood跟GTY4_powergood模块,可能是因为设置的是GTHE3所以没用到吧,暂时先不管了,在顶层结构向下找,找到gtwizard_ultrascale_0_gtwizard_gthe3.v文件,之前被顶层设置的参数都被传递到了这里,在调用的过程中,该文件的某些输入管脚被赋了特定值,但鉴于数量...
2018-12-03 13:31:18
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原创 GTHE3开发记录2
使用Kinex7 Ultrascale系列的芯片建立工程,然后使用UltraScale FPGAs Transceivers Wizard IP Core的默认设置(32bits收发原数据的Start from scratch)打开Example Design工程。分析如下:top模块:1.输入输出信号:mgtrefclk0_x0y3_p/n : IP GUI界面的Actual Refer...
2018-11-20 23:45:10
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原创 GTHE3开发记录1
最近有个项目用到KU系列的板子开发SATA3.0接口与SSD进行高速数据传输。鉴于工程有点复杂,借此博客做些记录,也供大家共同进步。Xilinx公司有提供了GTP、GTH、GTX、GTZ、GTY多种高速串并转换口,在建立Vivado工程选择芯片具体型号时就可以看到各个芯片所具有的资源数量。我使用的是xcku060-ffva1156-2-e型号具有28个GTHE3可调用高速串并转换收发器。万事开...
2018-11-19 10:48:08
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GM8285C器件手册
2017-11-30
UltraEdit-32高亮显示matlab语言
2014-07-13
空空如也
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